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ISL97635A
Electrical Specifications
All specifications below are tested at T A = -40°C to +85°C; V IN = 12V, EN = 5V, R SET = 36.6k Ω , unless
otherwise noted. Parameters with MIN and/or MAX limits are 100% tested at +25°C, unless otherwise
specified. Temperature limits established by characterization and are not production tested. (Continued)
PARAMETER
DESCRIPTION
CONDITION
MIN TYP MAX UNIT
Eff_peak
Δ I OUT / Δ V IN
D max
D min
Peak Efficiency
Line Regulation
Boost Maximum Duty Cycle
Boost Minimum Duty Cycle
V IN = 18V, 54 LEDs, 20mA each, L = 8.2μH
with DCR 106m Ω, T A = +25°C
V IN = 12V, 54 LEDs, 20mA each, L = 8.2μH
with DCR 106m Ω, T A = +25°C
V IN = 6V, 54 LEDs, 20mA each, L = 8.2μH
with DCR 106m Ω, T A = +25°C
82
91
88
86
0.1
7
%
%
%
%
%
%
F OSC_hi
F OSC_lo
ILX_leakage
LX Frequency
LX Frequency
LX Leakage Current
Register 0x08, f SW = 1
Register 0x08, f SW = 0
VLX = 36V, EN = 0
1.0
550
1.2
600
1.3
650
10
MHz
kHz
μA
REFERENCE
I MATCH
Channel-to-Channel Current Matching
I OUT = 30mA, BRT = 255
-3.5
±1
+3.5
%
I ACC
Current Accuracy
±3
%
FAULT DETECTION
V SC
Short Circuit Threshold
Reg0x08 = 0x0F or 0x0B Reg0x00 = 0xFF
Reg0x08 = 0x0E or 0x0A Reg0x00 = 0xFF
7.8
2.8
8
3.1
8.8
3.8
V
V
V temp_acc
Over-Temperature Threshold Accuracy
5
° C
V OVPlo
OVP hys
OVP fault
Overvoltage Limit on OVP Pin
OVP Hysteresis
OVP Short Detection Fault Level
1.17
1.2
20
300
1.23
V
mV
mV
SMBus INTERFACE
VIL
Guaranteed Range for Data, Clock Input Low
0.8
V
Voltage
VIH
Guaranteed Range for Data, Clock Input High
2.1
VDD
V
Voltage
VOL
SMBus Data Line Logic Low Voltage with 1.1k Ω
I PULLUP = 350μA
0.4
V
Series Resistor from Data Bus to SMBDAT pin
SMBus Data Line Logic Low Voltage without Series
I PULLUP = 4mA
0.17
V
Resistor from Data Bus to SMBDAT Pin
I LEAK
Input Leakage on SMBData/SMBClk
-1
1
μA
V DD
Nominal Bus Voltage
3V to 5V ±10%
2.7
5.5
V
SMBus TIMING SPECIFICATIONS (Note 4)
f SMB
t BUF
t HD:STA
SMBus Clock Frequency
Bus Free Time between STOP and START Condition
Hold Time after (Repeated) START Condition. After
10
4.7
4.0
100
kHz
μs
μs
this Period, the First Clock is Generated.
t SU:STA
t SU:STO
t HD:DAT
Repeated Start Condition Setup Time
Stop Condition Setup Time
Data Hold Time
5
4.7
4.0
300
μs
μs
ns
FN6564.2
December 22, 2008
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